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摘要 瓴盛科技采用新思科技广泛的DesignWare IP核组合来降低风险并加快新一代移动芯片组上市 用于USB、MIPI和DDR的高品质DesignWare...

PrimeTime时序signoff和StarRC提取，可显着提高在多场景、分布式处理运行中吞吐量。通过云计算资源进行多场景分析与优化节省大量成本。合著的白皮书已在台积公司网站开放下载，助力客户运行云上时序signoff流程。新思科技与台积公司(TSMC)和微软的合作已经实现了一项突破性的、可高度扩展的云上时序signoff流程。三方通过长达数月的深度合作加速下一代片上系统(SoC)的signoff。通过在微软Azure平台上使用新思科技PrimeTime®静态时序分析和StarRC™寄生提取，该流程可显著提高吞吐量。

新思科技DesignWare®真随机数发生器(TRNG) IP已通过美国国家标准与技术研究院(NIST)密码算法验证体系(CAVP)的验证，为客户终端产品获得低风险联邦信息处理标准(FIPS) 140-3认证铺平道路。新思科技的标准化TRNG IP帮助保护设备及其与其他设备或云的连接。TRNG IP提供对于加密、身份验证、平台安全和高度安全通信而言至关重要的高熵随机数。集成DesignWare TRNG IP可加速FIPS 140-3、通用标准和其他认证，降低物联网、汽车和云通信等的片上系统(SoC)设计风险，并缩短上市时间。

助力高性能计算、移动、5G和人工智能SoC设计，新思科技的工具结合台积公司先进制程技术，共同为N5和N6制程的客户提供认证解决方案。与台积公司的战略合作带来了更高性能和超低功耗，并加快了下一代设计的进程。

新思科技宣布推出业界首款完整的DesignWare® USB4™ IP 解决方案，该解决方案由控制器、路由器、PHY和验证IP组成。DesignWare USB4 IP的最高传输速度为40 Gbps，是USB3.2的最高数据传输率的两倍，并可向下兼容USB 3.x和USB2.0系统。DesignWare USB4 IP支持多个高速接口协议，包括USB4、DisplayPort 1.4a TX、PCI Express和Thunderbolt 3，通过一根USB Type-C®数据线即可实现高效的数据传输、高清视频传输，还可以提供电源。

新思科技与Arm携手合作，帮助Arm包括Arm® Cortex®-A78和Cortex-X1 CPU，以及Mali™-G78 GPU在内最新移动处理器IP的早期采用者，成功实现优化型片上系统(SoC)的流片。

硅IP供应商Alphawave已采用新思科技定制设计平台来加速多标准连接解决方案的设计。Alphawave选择新思科技来替代其原有的设计系统，这是基于其出色的整体设计生产力。

摘要： DesignWare 接口PHY IP包括112G/56G Ethernet、Die-to-Die、PCIe 5.0、CXL、CCIX和内存接口IP，能够支持最高速率...

新思科技宣布为谷歌的TensorFlow for Microcontrollers软件提供支持，该软件已针对新思科技的DSP增强型DesignWare® ARC®处理器IP进行了优化。TensorFlow Lite for Microcontrollers端口可连接到新思科技的DSP增强型DesignWare ARC EM和 HS处理器，支持在资源受限的边缘设备上部署各种机器学习应用...

松下将在所有工艺技术和应用的模拟、混合信号和射频集成电路设计上使用新思科技定制设计平台。松下在完成严格的技术评估并成功迁移历史设计流程和数据之后，决定部署新思科技平台。